library IEEE;
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-- Created from ssremote.bin
-- On12/20/2018

entity ssremote is
	port (
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end ssremote;

architecture syn of ssremote is
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);

signal daddr: std_logic_vector(10 downto 0);

begin
   assremote: process (clk)
   begin
      if (clk'event and clk = '1') then
         if (we = '1') then
            RAM(conv_integer(addr)) <= din;
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         daddr <= addr;
      end if; -- clk 
   end process;

   dout <= RAM(conv_integer(daddr));
end;