library IEEE; use IEEE.STD_LOGIC_1164.all; use IEEE.STD_LOGIC_ARITH.all; use IEEE.STD_LOGIC_UNSIGNED.all; -- Created from serhm2.bin -- On 6/ 9/2016 entity serhm2 is port ( addr: in std_logic_vector(10 downto 0); clk: in std_logic; din: in std_logic_vector(23 downto 0); dout: out std_logic_vector(23 downto 0); we: in std_logic); end serhm2; architecture syn of serhm2 is type ram_type is array (0 to 2047) of std_logic_vector(23 downto 0); signal RAM : ram_type := ( x"000000", x"000000", x"000000", x"010000", x"8F0000", x"01FFFF", x"B0007B", x"B0007A", x"0100FA", x"100089", x"010000", x"B0007A", x"100099", x"100153", x"10014C", x"400140", x"330000", x"400132", x"330016", x"010000", x"B00079", x"200018", x"010001", x"B00079", x"4B0000", x"B0007A", x"01001F", x"700035", x"330020", x"000000", x"000000", x"200011", x"40007C", x"B0014E", x"010180", x"850000", x"100037", x"320011", x"000000", x"000000", x"0104B6", x"840000", x"200191", x"B000B4", x"32000F", x"0104B6", x"840000", x"010180", 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