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Thaddeus-Maximus
2026-04-03 15:58:58 -05:00
commit f3953d66ae
1516 changed files with 586639 additions and 0 deletions
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107
5i24/configs/hostmot2/source/sslbpram.vhd Executable file
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@@ -0,0 +1,107 @@
library IEEE;
use IEEE.STD_LOGIC_1164.all;
use IEEE.STD_LOGIC_ARITH.all;
use IEEE.STD_LOGIC_UNSIGNED.all;
-- Created from sslbpram.bin
-- On 5/11/2011
entity sslbpram is
port (
addra: in std_logic_vector(9 downto 0);
addrb: in std_logic_vector(9 downto 0);
clk: in std_logic;
dina: in std_logic_vector(7 downto 0);
douta: out std_logic_vector(7 downto 0);
doutb: out std_logic_vector(7 downto 0);
wea: in std_logic);
end sslbpram;
architecture syn of sslbpram is
type ram_type is array (0 to 1023) of std_logic_vector(7 downto 0);
signal RAM : ram_type :=
(
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);
signal daddra: std_logic_vector(9 downto 0);
signal daddrb: std_logic_vector(9 downto 0);
begin
asslbpram: process (clk)
begin
if (clk'event and clk = '1') then
if (wea = '1') then
RAM(conv_integer(addra)) <= dina;
end if;
daddra <= addra;
daddrb <= addrb;
end if; -- clk
end process;
douta <= RAM(conv_integer(daddra));
doutb <= RAM(conv_integer(daddrb));
end;